SEMINARIO 28-10-2016. Procesamiento Digital de Señal aplicado a la Detección de Partículas Energéticas

Ponente: Alberto Regadío (Asociación de Personal Investigador de INTA).

Día: 28 de octubre de 2016
Hora: 12:00 horas
Lugar: Auditorio del Centro de Astrobiología (CSIC-INTA)
Instituto Nacional de Técnica Aeroespacial
Ctra de Ajalvir, km 4
28850 Torrejón de Ardoz, Madrid

Para acceder al recinto del INTA es necesario solicitarlo previamente al correo electrónico seminarios@cab.inta-csic.es

Título: Procesamiento Digital de Señal aplicado a la Detección de Partículas Energéticas

Resumen: la Espectroscopía aplicada a la Electrónica Nuclear tiene como fin la caracterización de las partículas energéticas que llegan a un determinado detector (por ejemplo: de gas, centelleador o semiconductor). Esta caracterización se lleva a cabo mediante el procesamiento de señal en cadenas de detección.

La precisión en la caracterización de estas partículas se denomina resolución. El análisis de la resolución en sistemas de espectroscopia analógicos ha sido profundamente estudiado en estas últimas cuatro décadas. Sin embargo, con el desarrollo de los circuitos integrados, la electrónica digital se ha consolidado en este campo en estos últimos años, desplazando el uso de su equivalente analógica, con las correspondientes ventajas que conlleva, como la inclusión de varias etapas en un único circuito integrado, menor volumen y consumo, reconfigurabilidad, etc. Por ello se hace también necesario un análisis de la resolución en sistemas de espectroscopía que cuentan con procesamiento digital de señal para mejorar su resolución.

En esta charla se hablará de la influencia de los parámetros del procesamiento digital de señal, como pueden ser el orden del conformador, la frecuencia de muestreo, el ruido de cuantización o el tipo de conformación, en la resolución total de un sistema de espectroscopía.

Además se expondrán algunos algoritmos que permiten aumentar dicha resolución averiguando la frecuencia de muestreo y conformaciones óptimas. Dichos algoritmos son implementables en hardware utilizando dispositivos reconfigurables como FPGAs.

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